帧相关处理
帧相关处理帧相关模块，由帧相关控制器和一片存储器组成，进行帧相关的存储器采用大小为256 kB的静态存储器(SRAM)。帧相关控制器由FPGA实现，完成地址产生、存储器读写控制、帧相关计算功能，因为实时性的要求，即保证送往后端双帧存的数据不能中断，所以考虑到对逐个象素数据读写的同时就进行相关处理，而且需要在同一个象素时钟周期内完成。读写控制器在1个象素时钟周期的前半段需要读出存储器中的数据和当前帧数据进行相关处理；时钟周期的后半段再将相关处理完的数据写入存储器以备后用，这样送往后端双帧存的数据依然是和象素时钟对应的连续象素数据。
帧相关的工作流程如下：
(1)地址产生。地址的产生由一个象索计数器实现，输入信号为帧同步信号VS和象素时钟CLK。前端提供的帧同步信号VS为该计数器的复位信号，在每一帧的开始，计数器清零，然后根据象素时钟CLK计数生成地址，每个象素时钟周期内地址不变，依据此地址进行存储器的读写。
(2)读取已有数据及相关处理。在一个象素时钟周期的前半段，也就是CLK跳变为高电平时，读写控制器输出的读信号OEl为有效，读出前帧中一个象素的数据，送到FPGA内部实现的加法器的A口，与同时到达B口的当前帧的对应象素数据相加平均。
(3)数据保存及传输。在同一个象素时钟周期的后半段，也就是CLK跳变为低电平时，读写控制器输出的写信号WEl为有效，相关处理完的数据写回原来的地址，同时该数据也送往帧存写控制模块。
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