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› 飞利浦-大唐笔试题 用verilog/vhdl写一个fifo控制器(包括空,满,半满信号)
tuteng
发表于 2013-1-27 18:40:27
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飞利浦-大唐笔试题 用verilog/vhdl写一个fifo控制器(包括空,满,半满信号)