论坛 › FPGA资料下载 › Altera推荐的带异步清零，使能的D触发器的写法

陈飞龙 发表于 2017-10-29 17:50:47

Altera推荐的带异步清零，使能的D触发器的写法

module dff_control(clk, aclr, aload, ena, data, adata, q);
input clk, aclr, aload, ena, data, adata;
output q;
reg q;
always @ (posedge clk or posedge aclr or posedge aload)
begin
if (aclr)
q <= 1'b0;
else if (aload)
q <= adata;
else if (ena)
q <= data;
end
endmodul

陈飞龙 发表于 2017-10-29 17:51:41

LIBRARY ieee;
USE ieee.std_logic_1164.all;
ENTITY dff_control IS
PORT (
clk: IN STD_LOGIC;
aclr: IN STD_LOGIC;
aload: IN STD_LOGIC;
adata: IN STD_LOGIC;
ena: IN STD_LOGIC;
data: IN STD_LOGIC;
q: OUT STD_LOGIC
);
END dff_control;

ARCHITECTURE rtl OF dff_control IS
BEGIN
PROCESS (clk, aclr, aload, adata)
BEGIN
IF (aclr = '1') THEN
q <= '0';
ELSIF (aload = '1') THEN
q <= adata;
ELSE
IF (clk = '1' AND clk'event) THEN
IF (ena ='1') THEN
q <= data;
END IF;
END IF;
END IF;
END PROCESS;
END rtl;

芙蓉王 发表于 2017-10-30 09:24:22

Altera推荐的带异步清零，使能的D触发器的写法

zhangyukun 发表于 2017-10-30 09:26:30

Altera推荐的带异步清零，使能的D触发器的写法

fpga_feixiang 发表于 2017-11-1 16:34:04

不错，写的很好

陈飞龙 发表于 2017-11-4 17:54:39

谢谢查看！！！！！！！

大鹏 发表于 2017-11-5 10:54:33

谢谢楼主分享，受教了！

zxopenljx 发表于 2020-8-16 09:56:27

Altera推荐的带异步清零，使能的D触发器的写法

fpga_feixiang 发表于 2020-8-17 20:28:15

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雷磊 发表于 2022-4-21 14:27:16

基于FPGA的VGA图像控制器的设计与实现.pdf
http://www.fpgaw.com/forum.php?mod=viewthread&tid=133257&fromuid=54563
(出处: fpga论坛|fpga设计论坛)

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