小舍YZ 发表于 2017-11-1 17:16:36

学习Verilog-HDL的UART串行通讯模块设计及仿真

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zhangyukun 发表于 2017-11-2 09:29:33

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芙蓉王 发表于 2017-11-2 09:36:52

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zxopenljx 发表于 2019-11-16 10:24:17

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zxopenljx 发表于 2019-12-26 14:14:05

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