Python0291 发表于 2019-6-1 09:38:17

时钟化和信号的长度

雷磊 发表于 2019-6-1 15:25:47

时钟化和信号的长度

fpga_feixiang 发表于 2019-6-7 14:22:00

顶~~~~~~~~~~~~~~~~~

雷磊 发表于 2022-8-4 15:18:25

Verilog数字VLSI设计教程.rar
http://www.fpgaw.com/forum.php?mod=viewthread&tid=139643&fromuid=54563
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dameihuaxia 发表于 2022-8-5 15:02:05

CRC码校验纠错原理
http://www.fpgaw.com/forum.php?mod=viewthread&tid=139628&fromuid=58166
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