zhangyukun 发表于 2021-8-11 09:36:11

vivado与modelsim的关联以及器件库编译

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雷磊 发表于 2021-8-11 17:11:50

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zhangyukun 发表于 2021-8-12 10:35:09

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LYF 发表于 2021-8-19 16:05:31

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zxw123 发表于 2021-8-19 17:31:02

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dameihuaxia 发表于 2021-8-20 13:57:49

如何写好状态机_Verilog_CH06_FSM
http://www.fpgaw.com/forum.php?mod=viewthread&tid=136731&fromuid=58166
(出处: fpga论坛|fpga设计论坛)
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