VVIC 发表于 2010-6-26 02:04:24

我要设计一个位串的数组，并初始化，可编译通过不了

本帖最后由 fpgaw 于 2010-7-18 13:59 编辑

我的代码如下
subtype myvector is bit_vector(7 downto 0);
type cname is array(1 downto 0) of myvecor;

constant c_list:cname:=(x"41",x"42");

编译提示aggregates are supported only for types that map to an array of bits”, 应该怎么处理呢？

usd 发表于 2010-6-26 03:37:52

感觉你把vhdl写成C语言了。
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