FFT 发表于 2010-6-26 14:14:46

output&lt;=(conv_integer(input))&lt;='1';<br>
意思应该是 input 变为整数 对应的output位 输出为 &lsquo;1&rsquo;；其他为零<br>
但是 我也没见过这种语句 我学的 verilog

ups 发表于 2010-6-26 15:09:16

这个似乎有问题吧，请楼主给解释一下！

inter 发表于 2010-6-26 15:54:04

不就是左移吗。

UFO 发表于 2010-6-26 17:02:43

在verilog中可以 这样写<br>
<br>
always @(*) begin<br>
&nbsp; &nbsp;&nbsp; &nbsp; output = 8'b0;<br>
&nbsp; &nbsp;&nbsp; &nbsp; output = 1'b1;<br>
end

CHANG 发表于 2010-6-26 18:19:42

对，应该是左移

interig 发表于 2010-6-26 19:19:48

好好学习

CHAN 发表于 2010-6-26 20:33:52

output&lt;=(others)&lt;='0';<br>
表示将output的bit都置0<br>
<br>
output&lt;=(conv_integer(input))&lt;='1';<br>
表示将output对应的inout值的那一位置1

VVC 发表于 2010-6-26 22:09:56

大二的时候学过，但都快忘光了

ANG 发表于 2010-6-26 22:49:05

编译的结果应该没有区别的

UFO 发表于 2010-6-27 00:28:27

程序简短，电路不一定好，过分最求简单的程序，有时候编译器却不一定能很好的认出你的结构，反而不行<br>
所以，尽量用简单的，编译器容易分辨的语句写出来的电路才是最好的<br>
楼主要知道硬件描述语言和一般计算机语言的区别才好
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查看完整版本: 代码最简单的3-8译码器