论坛 › FPGA技术交流 › verilog 里可以这样表达吗if((cnt2==1) or (cnt4==1))

ccs 发表于 2011-1-13 09:21:24

verilog 里可以这样表达吗if((cnt2==1) or (cnt4==1))

verilog 里可以这样表达吗if((cnt2==1) or (cnt4==1))

miwueshine 发表于 2011-1-18 13:23:34

不可以这样表达，不符合基本的语法。“or”在编程语言中一般用“|”（或）来表达，在这个表达中你试下if((cnt2==1) ||(cnt4==1))。

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