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FPGA技术交流 今日: 0|主题: 13347|排名: 8 

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预览 怎么用matlab进行滤波器的仿真验证 谁能告诉一下 wang 2010-5-25 22233 Sunlife 2015-5-19 15:16
预览 要实现数字下变频器,altera有什么IP吗?一般推荐什么系列的FPGA? IPO 2010-5-24 22159 Sunlife 2015-5-19 15:16
预览 when I get the quartusii software license IPO 2010-5-24 21926 Sunlife 2015-5-19 15:16
预览 对于较复杂的系统,开发时使用语言容易些还是使用原理图容易些?谢谢 IPO 2010-5-24 22202 Sunlife 2015-5-19 15:16
预览 如何才能使原理图输入的所有逻辑不会被综合优化掉? IPO 2010-5-24 21883 Sunlife 2015-5-19 15:15
预览 我是初学者,您认为先用MAX PLUS II 好,还是用QuartusII 好 IPO 2010-5-24 22066 Sunlife 2015-5-19 15:15
预览 QUARTUS2会自动调用MODELSIM ,但不会加载波形? IPO 2010-5-24 22706 Sunlife 2015-5-19 15:15
预览 用NIOS配置完PFGA/CPLD后是不是已经可以作为CPU使用,比如代替单片机? IPO 2010-5-24 22127 Sunlife 2015-5-19 15:08
预览 从fpga的内部ram中存取数据,是存耗时长,还是取耗时长呢 IPO 2010-5-10 43084 Sunlife 2015-5-19 14:59
预览 IP 里开一个深度为8的8FIFO ,则usedw[2..0]表示的深度最大为7.有矛盾吗 ccs 2010-5-17 22183 Sunlife 2015-5-19 14:58
预览 奇怪了为什么是PLB而不是OPB hjj3547110 2010-5-17 22238 Sunlife 2015-5-19 14:57
预览 用FPGA 做一个16位计数器,价格面议! feige7770 2010-5-14 42362 Sunlife 2015-5-19 14:57
预览 一个简单的总线轮询仲裁器Verilog实现 ccs 2010-5-14 23030 Sunlife 2015-5-19 14:57
预览 请问怎样用verilog实现一个自动生成指定频率的模块啊? attachment IPO 2010-5-10 32478 Sunlife 2015-5-19 14:56
预览 求高手帮我找下这个滤波器设计中的错误 有一处小错误 qq376784106 2010-5-12 22069 Sunlife 2015-5-19 14:56
预览 调查:用verilog or VHDL? CPLD 2010-5-13 42653 Sunlife 2015-5-19 14:38
预览 要用VHDL写个向量乘法器,这个向量乘法器和平时说的向量乘法是一个意思吗? CPLD 2010-5-13 22380 Sunlife 2015-5-19 14:20
预览 LVDS电缆设计问题 IPO 2010-5-15 33798 Sunlife 2015-5-19 10:54
预览 usb 2.0 的时钟速率是多少 IPO 2010-5-15 22171 Sunlife 2015-5-19 10:54
预览 PWM 调相 控制可控硅 20080067 2010-5-3 32860 Sunlife 2015-5-19 10:47
预览 0X2000000是不是每一位对应一个地址线? CPLD 2010-5-3 32177 Sunlife 2015-5-19 10:47
预览 请教Quartus中双向引脚问题 bravem 2010-5-3 33332 Sunlife 2015-5-19 10:34
预览 求助,fpga 层次化设计的方法有哪些啊..在线等 wh5142 2010-5-14 22293 Sunlife 2015-5-19 10:32
预览 synplify综合时遇到问题:在FPGA设计的过程中,不希望synplify综合时进行优化 IPO 2010-5-14 42488 Sunlife 2015-5-19 10:17
预览 求助!求高手用Verilog或者VHDL编写一个循环寄存器 qq376784106 2010-4-29 53444 Sunlife 2015-5-19 10:16
预览 用nios2的时候建立工程完 报错 ccs 2010-5-4 22482 Sunlife 2015-5-19 10:04
预览 初学QII,请教个问题,我把下面的测试程序设为顶层文件  ...2 CPLD 2010-5-14 126841 Sunlife 2015-5-19 10:03
预览 碰到一个问题 20080067 2010-4-27 42634 Sunlife 2015-5-19 10:00
预览 小弟:ISE调用modelsim进行前仿真的遇到的麻烦 IPO 2010-5-14 23199 Sunlife 2015-5-19 09:55
预览 请问quartus ii9.0是否支持win7,我用同样的安装文件在xp下没有问题? IPO 2010-5-14 33134 Sunlife 2015-5-19 09:53
预览 如何用用verilog编写一个芯片的驱动,能否给点思路呀 IPO 2010-5-14 22311 Sunlife 2015-5-19 09:43
预览 VHDL或Verilog 语言设计程序时,对输入输出端口的处理 20080067 2010-5-3 32466 Sunlife 2015-5-19 09:42
预览 选择VHDL还是verilog HDL? 20080067 2010-4-29 42848 Sunlife 2015-5-19 09:42
预览 verilog这个语句能执行吗?语法对吗 ccs 2010-5-5 32247 Sunlife 2015-5-19 09:39
预览 verilog设计经验总结 20080067 2010-5-3 22225 Sunlife 2015-5-19 09:38
预览 求基于Verilog的sfk调制解调的资料 新人帖 Aiby2015 2015-5-17 01000 Aiby2015 2015-5-17 09:24
预览 quartusII如何给lvds线配置差分电阻? ccs 2010-5-11 43988 Sunlife 2015-5-16 16:23
预览 QuartusII9.1中是否有Modelsim Altera? ccs 2010-5-6 43831 Sunlife 2015-5-16 14:16
预览 如何卸载ISE 12.1 CPLD 2010-5-13 39240 Sunlife 2015-5-16 12:02
预览 求VHDL代码 attach_img lefthook 2010-5-5 22040 Sunlife 2015-5-16 11:41
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