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预览 verilog语法错误,请大侠指点  ...2 CHANG 2010-6-26 157266 Sunlife 2015-4-7 11:13
预览 CPLD真的可以用例化元件做时钟吗?  ...23 usd 2010-6-26 2812567 Sunlife 2015-4-7 11:12
预览 cpld设计,现在外部时钟是24M,有个输出信号想要延时10ns后输出,请教怎样实现?  ...2 UFO 2010-6-26 157482 Sunlife 2015-4-7 11:11
预览 如何对单独的VHDL子模块文件编译仿真? CHAN 2010-6-26 77693 Sunlife 2015-4-7 11:10
预览 74393M是什么器件? AAT 2010-6-26 52961 Sunlife 2015-4-7 11:08
预览 状态机为什么要next_state这个东西? interi 2010-6-26 83779 Sunlife 2015-4-7 11:07
预览 这个verilog程序不能综合成为状态机? 神仙姐姐 2010-6-26 73440 Sunlife 2015-4-7 11:07
预览 三段式状态机问题 夜带水果刀 2010-6-26 32295 Sunlife 2015-4-7 11:05
预览 状态机到底是什么东西吗?难道就仅仅是指触发器一类的器件吗? VVC 2010-6-26 43394 Sunlife 2015-4-7 11:02
预览 用Q2编译EMP240出错 interig 2010-6-26 31977 Sunlife 2015-4-7 11:01
预览 书写HDL代码的风格 longtime 2010-6-26 32908 Sunlife 2015-4-7 10:58
预览 Verilog里面既然有乘法运算了,为什么FPGA的IP核里还有乘法器这个东西? 老怪甲 2010-6-25 43050 Sunlife 2015-4-7 10:52
预览 菜鸟求助 billcj 2010-6-24 32095 Sunlife 2015-4-7 10:41
预览 请教:在IDE中的奇怪错误 清霜一梦 2010-6-4 32432 Sunlife 2015-4-7 10:39
预览 利用10M的时钟,设计一个周期为50微秒单周期的输出时钟,其中波峰为10微秒 vvt 2010-5-26 22200 Sunlife 2015-4-7 10:38
预览 双沿触发的VHDL实现 老怪甲 2010-5-25 12428 Sunlife 2015-4-7 10:37
预览 总线仿真的问题 narugg 2010-5-17 11929 Sunlife 2015-4-7 10:36
预览 FPGA验证工程师到底要学什么? IPO 2010-5-14 33037 Sunlife 2015-4-7 10:36
预览 FPGA 设计的四种常用思想与技巧(二) 老怪甲 2010-5-5 12048 Sunlife 2015-4-7 10:34
预览 怎样用FPGA实现PCI或网络通信啊? 20080067 2010-4-27 42216 Sunlife 2015-4-7 10:33
预览 FPGA设计应注意的一些问题 小泡泡 2010-4-23 12493 Sunlife 2015-4-7 10:33
预览 用流水线技术提高同步电路的速度 小泡泡 2010-4-23 12131 Sunlife 2015-4-7 10:32
预览 设计技术问答:FPGA设计的安全性考量 老怪甲 2010-4-16 12031 Sunlife 2015-4-7 10:30
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