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预览 rtl视图应该是什么样?? 920628 2013-7-22 01092 920628 2013-7-22 09:15
预览 弱弱的请教大家一个问题,若有一个20X20CM的六层PCB,网标无法导入,三天能做完吗? 920628 2013-7-21 0944 920628 2013-7-21 17:43
预览 谁知道世界上最出名的PCB企业有哪几家 920628 2013-7-21 0866 920628 2013-7-21 17:26
预览 FPGA内部有没有可以例化的除法器?? 920628 2013-7-21 0974 920628 2013-7-21 16:06
预览 请问再添加nios的时候编译会出错应该怎么做呢 920628 2013-7-21 11014 920628 2013-7-21 15:33
预览 出现了这样两条错误 请问哪位高手能指点下啊…… 920628 2013-7-21 01006 920628 2013-7-21 15:29
预览 为什么开发板没上电时候能检测到USB_b。一上电线就没了。。 920628 2013-7-21 0937 920628 2013-7-21 14:59
预览 是先分配引脚 后编译 在下载 还是先编译 后分配引脚 再下载 ?? 920628 2013-7-21 0896 920628 2013-7-21 11:33
预览 可以编译通过 下载到板子上就运行不了 为啥?? 920628 2013-7-21 01011 920628 2013-7-21 10:54
预览 计数分频 50M -> 67Hz, 示波器看只有47Hz,很不准怎么办? 920628 2013-7-21 0897 920628 2013-7-21 10:49
预览 sounce_exp【5:0】 是什么意思 920628 2013-7-21 0970 920628 2013-7-21 10:23
预览 写你的AD是不停的工作吗? 920628 2013-7-21 0903 920628 2013-7-21 10:21
预览 问下大家DSP Builder 都是用的哪个版本的啊 920628 2013-7-21 0982 920628 2013-7-21 10:18
预览 采集波形数据用FIFO存储,同时读写数据的时候怎样才能使存入FIFO的波形数据连续? 920628 2013-7-21 0875 920628 2013-7-21 10:16
预览 怎么解决无线模块电压不一样的问题 920628 2013-7-21 0908 920628 2013-7-21 10:10
预览 遇到spi flash 焼写速度太慢的问题 ccs 2013-7-21 21045 ccs 2013-7-21 07:24
预览 xilinx ISE 14.4中怎么设置未使用IO的方式? ccs 2013-7-21 21087 ccs 2013-7-21 07:17
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预览 求大神指点什么原因 1693269416 2013-7-20 01026 1693269416 2013-7-20 17:21
预览 fpga 接收 以太网 数据包时,包头有个sop,包尾有个eop,这个常用吗? 北京幸福时代 2013-6-1 31292 1693269416 2013-7-20 17:04
预览 请问一下verilog里面怎么把连个模块连接起来? 1693269416 2013-7-3 2846 1693269416 2013-7-20 17:01
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预览 求救:调制解调器使用matlab仿真的时候误码率一直居高不下。求救啊 920628 2013-7-20 0926 920628 2013-7-20 09:21
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