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预览 有没有FPGA高手调试过S29JL064H这款FLASH吗 ccs 2022-2-24 11024 大鹏 2022-3-16 16:32
预览 verilog全加器的测试代码 vhdl 2010-8-13 84088 大鹏 2022-3-16 16:32
预览 想问下altera的FPGA可以设置加载时io口状态为下拉吗 ccs 2022-3-15 3806 LYF 2022-3-15 17:05
预览 HA16666FP开关稳压器控制电路 tianya123 2010-11-13 32046 大鹏 2022-3-15 16:26
预览 我今天尝试了一下golden在updata写了一半数据起不来的问题。我发现我把仿真器连接... ccs 2022-3-15 1752 大鹏 2022-3-15 16:26
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预览 建立时间与保持时间的概念 fpga_feixiang 2020-4-18 31683 大鹏 2022-3-14 09:37
预览 WPM脉宽调制IP核(verilog) longtime 2010-6-28 62524 zxopenhl 2022-3-14 09:35
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预览 IDM.zip attachment fpga_feixiang 2022-3-11 1783 大鹏 2022-3-12 15:46
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预览 Artix-7-50T EVM 试用日志(三)——MicroBlaze测试DDR3 attach_img zxopenhl 2018-5-22 52049 大鹏 2022-3-11 16:49
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预览 有没有FPGA高手做过sdc约束,或者有sdc的模板吗 ccs 2022-2-24 0806 ccs 2022-2-24 11:21
预览 fpga里两个模块之间定义一个80位宽的端口连接和用五个16位宽的端口连接有时序好坏... ccs 2022-2-22 2850 大鹏 2022-2-24 09:38
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