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预览 谁有脉动门阵列的verilog程序啊 vhdl 2010-12-27 21467 wangxia6112 2010-12-28 10:57
预览 求救啦,verilog时钟 heracles1 2010-12-25 52158 wangxia6112 2010-12-28 10:56
预览 有人了解crc32吗 I2C 2010-11-12 21493 kelly07050505 2010-12-28 09:56
预览 有人帮做一下本科课程的VHDL设计期末作业么? attachment 浅燃之烬 2010-12-27 32359 kelly07050505 2010-12-28 09:51
预览 这样的代码格式正确吗?在ISE12.3里的GLBL.V里有这样的语句 vhdl 2010-12-28 11631 vhdl 2010-12-28 08:48
预览 Formality形式验证问题 vhdl 2010-12-28 01800 vhdl 2010-12-28 08:45
预览 按书本打了个测试程序,编译时提示: vhdl 2010-12-27 11474 njithjw 2010-12-27 20:58
预览 学FPGA的学日语有好处吗?有前途不? vvt 2010-12-27 01550 vvt 2010-12-27 20:39
预览 谁有Virtex-II Pro开发板USB驱动啊 vhdl 2010-12-27 01283 vhdl 2010-12-27 12:55
预览 请问,FPGA给PC机发送的数据怎么都是乱码呀? vhdl 2010-12-27 01555 vhdl 2010-12-27 12:55
预览 基于FPGA的具有数字显示的水温测控系统 attach_img weibode01 2010-12-1 11489 443836870 2010-12-26 22:50
预览 大家有没有人用FPGA做过语音方面的东西 IPO 2010-12-26 21417 ccs 2010-12-26 13:45
预览 谁知道Verilog里time的用法呢? vhdl 2010-12-24 12115 IPO 2010-12-26 09:05
预览 对于利用冲激响应不变法设计IIR数字滤波器 I2C 2010-12-26 01472 I2C 2010-12-26 05:21
预览 请大家给推荐一款FPGA开发板! I2C 2010-12-26 21700 I2C 2010-12-26 05:20
预览 【求助】SOPC\DSP Builder\VHDL 的异同 wildcrane 2010-12-26 01709 wildcrane 2010-12-26 04:45
预览 我想问下fpga是基于查找表结构,究竟是什么结构? IPO 2010-12-8 21668 nemo 2010-12-25 19:24
预览 急毕业设计 FPGA控制液晶屏字幕显示 lrm 2010-12-23 11339 smallwind1 2010-12-25 14:14
预览 关于视频采集的,高人帮帮忙! interige 2010-6-28 21783 luqingyun 2010-12-25 01:53
预览 为啥用quartus通过编译和综合的到了maxplus 今天用quartus被鸟屎说从网上抄袭 IPO 2010-12-23 42610 guojun 2010-12-24 19:22
预览 有朋友用QUARTUS 9.0的没呀?~ vhdl 2010-12-24 31765 guojun 2010-12-24 19:20
预览 弱弱的问下 lesson 2010-12-21 21627 焉柳尔 2010-12-24 17:01
预览 xilinx ip核仿真 applelonger 2010-12-20 11589 焉柳尔 2010-12-24 17:01
预览 FPGA技术交流群500人 175370031 焉柳尔 2010-12-24 31832 焉柳尔 2010-12-24 16:58
预览 请问怎么用分频计数 延时计数 0.5 S 啊~ 要求误差尽可能的小 vhdl 2010-12-24 01220 vhdl 2010-12-24 15:51
预览 请教如何在Verilog中表示负数 attach_img sepathy@163.com 2010-12-21 37522 miwueshine 2010-12-24 10:09
预览 滤波器怎么设计? TCL 2010-12-23 01367 TCL 2010-12-23 19:52
预览 ARM怎么控制FPGA???谁能帮帮忙吗 IPO 2010-12-23 11441 IPO 2010-12-23 11:35
预览 如果差分电路输入电压变化,输入的基准也跟着变化 IPO 2010-12-23 11296 IPO 2010-12-23 11:35
预览 我想用Modelsim仿真RS核 IPO 2010-12-23 11522 IPO 2010-12-23 11:34
预览 万分感激你的关注!如何利用主端口发起DMA传输? skw 2010-12-23 01466 skw 2010-12-23 09:57
预览 编写一个程序要实现dsp输出的八路脉冲给FPGA进行取反 IPO 2010-12-23 11476 IPO 2010-12-23 08:36
预览 verilog 语法掌握差不多下一步怎么走?师哥 师姐帮帮忙指点一下 815436262 2010-12-21 21651 wangxia6112 2010-12-22 10:24
预览 case语句必须在always块下才可以 815436262 2010-12-21 01262 815436262 2010-12-21 21:41
预览 modelsim仿真需要关联什么吗? IPO 2010-12-19 11985 guojun 2010-12-21 21:35
预览 如何用verilog状态机编串口收发程序 CTT 2010-6-26 44211 兜里有糖糖 2010-12-21 21:19
预览 紧急求助 attach_img wqt128 2010-12-9 31876 hbaifenbai 2010-12-21 20:58
预览 仿真寄存器IP核还需要实例化寄存器吗 luftwaffe 2010-12-21 01662 luftwaffe 2010-12-21 12:28
预览 verilog语言,if语句中如何既保存原来的值又不生成锁存器? congbupt 2010-12-4 22738 hwakicestone 2010-12-21 11:49
预览 这样简单的东西也编译不过,真想去死了算了!!!  ...2 chengg1394 2010-12-16 104918 hwakicestone 2010-12-21 11:41
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