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预览 如何检测方波信号周期 pstone 2010-11-19 63007 兜里有糖糖 2010-12-31 19:54
预览 乐曲硬件演奏电路 zzzdaizi 2010-12-6 31695 兜里有糖糖 2010-12-31 19:51
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预览 写一个先进先出的储存器 128*8位的,怎么控制那个地址啊, IPO 2010-12-29 62543 mikechang 2010-12-31 16:00
预览 verilog hdl 入门大概要几个月  ...2 VVIC 2010-6-27 177120 mikechang 2010-12-31 15:50
预览 求助一个Verilog编程问题,请大家帮忙一下,急用,拜托了 attach_img 迷の傀儡师 2010-11-27 63360 兜里有糖糖 2010-12-31 15:24
预览 请问我想每来个时钟add加11 TCL 2010-4-14 63252 兜里有糖糖 2010-12-31 12:24
预览 大神们,请问谁用过ALTERA的DE2-70板子 guanguan 2010-12-31 01688 guanguan 2010-12-31 06:35
预览 关于CASE语句并行性的理解 20080067 2010-5-28 64751 lcawen 2010-12-30 22:51
预览 vhdl 2进制转换成10进制 ccs 2010-12-19 33189 lcawen 2010-12-30 22:41
预览 大伙有没有关于CPLD的实验范例 VVIC 2010-6-26 32252 lcawen 2010-12-30 22:34
预览 求助帮助verilog HDL转换成VHDL 急!!!课程设计··· ling2323 2010-12-23 11983 lcawen 2010-12-30 22:33
预览 VHDL中如何将两个模块中的inout互联 vhdl 2010-12-28 23004 lcawen 2010-12-30 22:31
预览 求救,这么简单的东西居然也编译不多去 chengg1394 2010-12-16 42133 lcawen 2010-12-30 21:45
预览 请教高手 ---系统级设计要考虑什么? 文气豪爽 2010-12-12 11243 西邮阿立 2010-12-29 20:05
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预览 怎样在同一周期内修改方波的占空比 pstone 2010-11-10 73396 西邮阿立 2010-12-29 19:48
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预览 谁有脉动门阵列的verilog程序啊 vhdl 2010-12-27 21590 wangxia6112 2010-12-28 10:57
预览 求救啦,verilog时钟 heracles1 2010-12-25 52294 wangxia6112 2010-12-28 10:56
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