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预览 初学者使用Quartus II中的问题 keepcome 2010-7-24 02076 keepcome 2010-7-24 15:01
预览 深圳承兴益电子有限公司样板收费标准 cxykk 2010-7-22 01702 cxykk 2010-7-22 17:14
预览 求助：这条语句具体是什么意思？ zhouliang 2010-7-21 01816 zhouliang 2010-7-21 17:51
预览 FPGA设计研修班（Altera初级培训班）--至芯FPGA创新中心 fpgaw 2010-7-21 02551 fpgaw 2010-7-21 08:11
预览 FPGA 用POWERpc 有人做吗？ I2C 2010-7-20 01655 I2C 2010-7-20 08:39
预览 有知道怎么用nc混合仿真verilog和vhdl的么 I2C 2010-7-20 01845 I2C 2010-7-20 08:39
预览 用verilog程序怎样实现10进制数转换为2进制 dds 2010-7-19 02082 dds 2010-7-19 10:26
预览 SOPC怎么来定制PWM组件时TYPE 里面怎么没有avalon_slave dds 2010-7-19 02080 dds 2010-7-19 09:08
预览 请问用FPGA的VGA显示图片怎么做啊？ dds 2010-7-19 02170 dds 2010-7-19 09:06
预览 我现在需要在fpga上需要输出一个 1mhz的差分信号，需要如何实现？ 谢谢 dds 2010-7-19 01637 dds 2010-7-19 09:05
预览 Innovation multi-channel DDCs IP core pornanier 2010-7-19 01821 pornanier 2010-7-19 01:07
预览 多重嵌套的case语句是否能被综合? fenlido 2010-7-18 01989 fenlido 2010-7-18 21:07
预览 请各路朋友帮帮忙 tianya 2010-7-15 01675 tianya 2010-7-15 16:28
预览 请问：达人高人viterbi核怎么用啊！ yl88888 2010-7-14 01682 yl88888 2010-7-14 17:35
预览 有没有用verilog HDL编写接口代码的？ luchunmei 2010-7-14 01778 luchunmei 2010-7-14 10:33
预览 此代码为什么会被优化掉?真奇怪 lzxylwq 2010-7-14 01798 lzxylwq 2010-7-14 08:15
预览 用Verilog如何产生一个信号sint miwueshine 2010-7-13 02156 miwueshine 2010-7-13 17:21
预览 请问在synplify pro 中复制RTL图时太大了，会失真怎么样解决不失真哈 dds 2010-7-11 01727 dds 2010-7-11 10:56
预览 请问在synplify pro 中复制RTL图时太大了，会失真怎么样解决不失真 vvt 2010-7-10 01892 vvt 2010-7-10 06:15
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预览 请教：在ISE的sch顶层设计里如何调用.ngc文件？ hucy6064 2010-7-9 02035 hucy6064 2010-7-9 10:06
预览 关于DATAES(多时钟域数据转换) 求助 急 four0clock 2010-7-8 01575 four0clock 2010-7-8 11:53
预览 在书上看了个另类3分频电路50%占空比，没看懂求指教 qglyj 2010-7-6 01638 qglyj 2010-7-6 15:37
预览 有没有人用过SYSTYEM generator 的 Mcode模块？ luchunmei 2010-7-5 01563 luchunmei 2010-7-5 11:02
预览 求购二手Xilinx FPGA开发板 jhtkiss 2010-7-3 01828 jhtkiss 2010-7-3 21:49
预览 光纤电流互感器数据处理算法的fpga实现要求用verilog hdl语言去做。 AAT 2010-7-3 01445 AAT 2010-7-3 06:17
预览 请问各位高手，quartus中的fitter一步执行完产生什么文件（仅是fitter这步产生的）？ jjdehai 2010-7-1 01658 jjdehai 2010-7-1 14:01
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