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预览 那位fpga高手大哥用VHDL做过浮点加减法器 AAT 2010-6-27 01969 AAT 2010-6-27 23:49
预览 关于VHDL到Verilog HDL的移植 usd 2010-6-27 01958 usd 2010-6-27 23:49
预览 verilog六选一扫描器 VVC 2010-6-27 01814 VVC 2010-6-27 23:48
预览 如何用VHDL语言生成顶层设计 CHANG 2010-6-27 02833 CHANG 2010-6-27 23:46
预览 怎么把一个程序放入work库没某个程序包中 ATA 2010-6-27 11704 longtim 2010-6-27 23:45
预览 请大家帮我看看MCU和CPLD通信的程序哪里有问题 usd 2010-6-27 01769 usd 2010-6-27 23:44
预览 sdram控制的疑问？ UFO 2010-6-27 01682 UFO 2010-6-27 23:44
预览 SCI与UART有什么区别？ ANG 2010-6-27 02890 ANG 2010-6-27 23:43
预览 仿真的时候输出没有波形，不知道问题出在哪里，是循环除了问题还是加法出了问题 ups 2010-6-27 01672 ups 2010-6-27 23:41
预览 FPGA做RAM问题 longtim 2010-6-27 01822 longtim 2010-6-27 23:41
预览 在综合时产生下面的警告是什么意思 VVIC 2010-6-27 01542 VVIC 2010-6-27 23:40
预览 弱问一个verilog语法问题 HANG 2010-6-27 12193 longt 2010-6-27 23:40
预览 求教高手下面的两个警告要怎么处理？？？有什么影响？？？ HANG 2010-6-27 21900 ANG 2010-6-27 23:40
预览 使用I/O引脚输出PWM脉冲调节平均电压 CCIE 2010-6-27 01819 CCIE 2010-6-27 23:40
预览 求救液晶驱动电路的设计 ngtim 2010-6-27 01564 ngtim 2010-6-27 23:38
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预览 inout端口类型具体怎么使用？？ inter 2010-6-27 02017 inter 2010-6-27 23:34
预览 请问怎么用modelsim 对verilog code 加密啊 ??? ICE 2010-6-27 03386 ICE 2010-6-27 23:30
预览 请帮忙看一下我的错误 VVC 2010-6-27 01783 VVC 2010-6-27 23:27
预览 怎么用HDL语言实现采样率2.5MHZ，占空比50%正负脉冲信号的累加计算？ interi 2010-6-27 01930 interi 2010-6-27 23:25
预览 用 FPGA 的计算机在实现 一项具体功能时的流程是如何的 ？ ICE 2010-6-27 01643 ICE 2010-6-27 23:24
预览 illegal Procedural Assignment 怎么修改啊 ATA 2010-6-27 01886 ATA 2010-6-27 23:20
预览 状态机实现的与8051总线接口 usb 2010-6-27 02103 usb 2010-6-27 23:19
预览 求助：文件怎么打开 mcs 和XSVF 用什么软件打开阿 FFT 2010-6-27 01848 FFT 2010-6-27 23:15
预览 关于sram的一个问题 encounter 2010-6-27 01718 encounter 2010-6-27 23:15
预览 FPGA设计脉冲量采集的加时码！ ANG 2010-6-27 01917 ANG 2010-6-27 23:14
预览 新手跪求帮助，FPGA带FFT核的处理速度表现该在哪里查？ manzhang708 2010-6-27 01680 manzhang708 2010-6-27 10:34
预览 如何用verilog语言读写flash  ...23 CCIE 2010-6-26 2417792 CTT 2010-6-27 04:40
预览 cpld可以实现一个260纳秒的延时 inter 2010-6-26 32316 HDL 2010-6-26 04:16
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预览 请教CPLD如何实现ARM扩展ISA总线 longt 2010-6-26 12595 CHAN 2010-6-26 04:12
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