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预览 求助,VHDL语言设计,急! tim 2010-6-26 11904 ATA 2010-6-26 02:41
预览 谁知道那有fpga advantage下载 CHANG 2010-6-26 01833 CHANG 2010-6-26 02:41
预览 one-hot状态机两种编码方式综合成果的比较 CHANG 2010-6-26 12997 CHANG 2010-6-26 02:37
预览 EPM3064A的IO口驱动能力怎么样？ CHAN 2010-6-26 13178 usb 2010-6-26 02:35
预览 有谁能说一下是verilog还是vhdl啊 CHA 2010-6-26 11789 CCIE 2010-6-26 02:34
预览 做asic 的迷茫 七郎仔 2010-6-25 52935 蓝雪 2010-6-26 02:30
预览 在vhdl中，用状态机实现和用同等功能的if_else语句实现，有什么区别？ inter 2010-6-26 12509 CCIE 2010-6-26 02:29
预览 在ISE下采用verilog编程遇到的几个问题，请指教 ICE 2010-6-26 42965 encounter 2010-6-26 02:29
预览 状态机的问题 有关检错的程序 AAT 2010-6-26 12211 ATA 2010-6-26 02:29
预览 fpga高手讨论一下代码的命名规范 HANG 2010-6-26 02155 HANG 2010-6-26 02:27
预览 EMP7064LC68用什么方式下载，看资料好像说不能用JTAG方式？ HANG 2010-6-26 11948 longt 2010-6-26 02:27
预览 状态编码到底怎么用? 麦子 2010-6-25 32491 一个人的舞台 2010-6-26 02:27
预览 关于从SLAVE端提取时钟的方式 纸风铃 2010-6-25 22143 七郎仔 2010-6-26 02:26
预览 verilog偶数个非门进行短暂的延时防止优化的问题 纸风铃 2010-6-25 42587 帅帅 2010-6-26 02:25
预览 关于示波器等效采样和实时采样 longt 2010-6-26 01771 longt 2010-6-26 02:25
预览 MAX PLUS II 的时钟频率问题 longt 2010-6-26 22665 CCIE 2010-6-26 02:24
预览 我的CPLD延迟7ns对外部SRAM的地址加减和re.oe.ce控制,回影响数据的读写吗 CHANG 2010-6-26 12172 longt 2010-6-26 02:24
预览 请教设计停表的verilog 代码 inter 2010-6-26 12355 longtim 2010-6-26 02:24
预览 Quartus里说生成netlist必须用smnplicity而不能用synplicity pro? longtime 2010-6-26 02171 longtime 2010-6-26 02:23
预览 同一型号的封装管脚不同能编译一样么！ tim 2010-6-26 01808 tim 2010-6-26 02:21
预览 【求助】 有关状态机自动售货机设计 ICE 2010-6-26 12276 ICE 2010-6-26 02:21
预览 这个芯片的管脚信息:EPF10K20TC144-3 ATA 2010-6-26 02096 ATA 2010-6-26 02:19
预览 SPI Flash ROM 取代 EPROM 可行? CCIE 2010-6-26 32249 interi 2010-6-26 02:19
预览 FPGA 读写DPRAM错误 interi 2010-6-26 12065 HDL 2010-6-26 02:15
预览 为何异步复位那要加2个D触发器才能保证无亚稳态？ longtim 2010-6-26 02249 longtim 2010-6-26 02:15
预览 在状态机里加入并行向串行转换 VVC 2010-6-26 12293 CHA 2010-6-26 02:14
预览 如何用verilog 编写对数等式？？ AAT 2010-6-26 22327 CTT 2010-6-26 02:12
预览 关于fpga编程时的时序问题该如何匹配呢？ longt 2010-6-26 01943 longt 2010-6-26 02:12
预览 vhdl代码在webpack6.2 下assigned package pins 时发生的问题？ longtime 2010-6-26 01777 longtime 2010-6-26 02:08
预览 状态机可以嵌套吗？就是一个state和一个sub_state?还是得把它们写成并列的状态呢？ VVIC 2010-6-26 22443 tim 2010-6-26 02:07
预览 用verilog编写testbench,ModelSim的大牛可否过来指点一下？ interig 2010-6-26 03487 interig 2010-6-26 02:06
预览 如何不让Quartus2生成这些后缀的文件？ CHA 2010-6-26 02113 CHA 2010-6-26 02:06
预览 有关moore，mealy两种状态机的教程吗？ AAT 2010-6-26 22644 CHA 2010-6-26 02:04
预览 CPLD可以接几个晶振 CHAN 2010-6-26 02281 CHAN 2010-6-26 02:03
预览 谁用过synplicity 的 Certify CHAN 2010-6-26 02161 CHAN 2010-6-26 02:03
预览 [求教]关于VHDL变量在状态机中赋值的问题 VVC 2010-6-26 02195 VVC 2010-6-26 02:03
预览 谁使用过STRATIX1S10这块板子？ usb 2010-6-26 01877 usb 2010-6-26 02:02
预览 [求助]assign package pins时出问题 VVIC 2010-6-26 02131 VVIC 2010-6-26 02:01
预览 [求助]ISE在VHDL中怎样使用一个编译好的SCH资源？ ICE 2010-6-26 02149 ICE 2010-6-26 01:58
预览 请教：不同的工艺库仿真时对不定态的处理问题 别生气咯 2010-6-26 12179 豆芽 2010-6-26 01:58
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