fpga论坛|fpga设计论坛

 找回密码
 我要注册

QQ登录

只需一步,快速开始

搜索
收藏本版 (8) |订阅

FPGA技术交流 今日: 0|主题: 13347|排名: 7 

作者 回复/查看 最后发表
预览 Sobel算子 fpga_feixiang 2020-7-11 21263 大鹏 2020-7-12 19:25
预览 跳频扩频(FHSS) fpga_feixiang 2020-7-4 21416 大鹏 2020-7-9 15:15
预览 扩频处理的带宽 fpga_feixiang 2020-7-4 21377 zxopenhl 2020-7-9 15:13
预览 高斯滤波 fpga_feixiang 2020-7-8 21605 大鹏 2020-7-8 17:49
预览 双边滤波 fpga_feixiang 2020-7-8 31347 大鹏 2020-7-8 17:49
预览 均值滤波 fpga_feixiang 2020-7-8 21299 zxopenhl 2020-7-8 17:48
预览 中值滤波 fpga_feixiang 2020-7-8 11270 fpga_feixiang 2020-7-8 16:18
预览 解扩处理的带宽 fpga_feixiang 2020-7-4 21337 大鹏 2020-7-7 17:08
预览 基于RS232总线收发数据设计 fpga_feixiang 2020-7-5 21589 大鹏 2020-7-7 17:07
预览 uart实验 fpga_feixiang 2020-7-5 21423 zxopenhl 2020-7-7 17:06
预览 DDS实现方案 fpga_feixiang 2020-6-22 21439 大鹏 2020-7-4 10:09
预览 扩频理论的基础 fpga_feixiang 2020-7-2 31339 大鹏 2020-7-4 10:08
预览 CPU工作的基本原理以及如何设计一个简单的16位CPU模型 fpga_feixiang 2020-7-2 31528 zxopenhl 2020-7-4 10:07
预览 RISC CPU中各部件的相互连接关系 fpga_feixiang 2020-6-30 21434 zxopenhl 2020-7-3 11:38
预览 用EPF10K10LC84-4制作多功能电子钟 CHA 2010-6-28 12246 大鹏 2020-7-2 11:06
预览 基于Actel FPGA的UART应用 20080067 2010-5-3 23266 zxopenhl 2020-7-2 11:05
预览 VERILOG四位加法 fpga_feixiang 2020-7-1 31414 zhangyukun 2020-7-2 09:49
预览 Verilog中的信号 fpga_feixiang 2020-7-1 21507 大鹏 2020-7-1 17:23
预览 RISC CPU和它的外围电路 fpga_feixiang 2020-6-30 11247 fpga_feixiang 2020-6-30 15:15
预览 RISC CPU结构 fpga_feixiang 2020-6-30 11397 fpga_feixiang 2020-6-30 15:14
预览 FPGA开发板为什么要使用SDRAM attach_img 英尚微电子 2020-6-28 31699 大鹏 2020-6-30 14:46
预览 CPU设计原理 fpga_feixiang 2020-6-28 31655 大鹏 2020-6-30 14:45
预览 什么是CPU fpga_feixiang 2020-6-28 21454 zxopenhl 2020-6-30 14:44
预览 FPGA的应用场景 fpga_feixiang 2020-5-8 41610 大鹏 2020-6-28 14:09
预览 DDS结构图 fpga_feixiang 2020-6-22 21348 zxopenhl 2020-6-28 14:08
预览 双向管脚(clocked bidirectional pin)Verilog代码 老怪甲 2010-5-28 13104 大鹏 2020-6-27 14:55
预览 Modelsim后仿真心得 ccs 2010-6-20 23046 大鹏 2020-6-27 14:54
预览 fpga应用的三个主要方向 fpga_feixiang 2020-1-3 41816 大鹏 2020-6-26 17:35
预览 状态机综合的问题 interi 2010-6-26 64241 zxopenhl 2020-6-26 17:34
预览 vhdl介绍 fpga_feixiang 2020-6-25 21152 大鹏 2020-6-25 17:02
预览 VHDL与Verilog HDL的发展历程 fpga_feixiang 2020-6-25 21297 大鹏 2020-6-25 17:01
预览 vhdl和verilog的共同点 fpga_feixiang 2020-6-25 21200 zxopenhl 2020-6-25 17:00
预览 状态机的控制信号问题. CHAN 2010-6-26 12600 大鹏 2020-6-24 11:50
预览 Verilog中的注释 fpga_feixiang 2020-6-23 31572 zxopenhl 2020-6-24 11:48
预览 DDS原理分析 fpga_feixiang 2020-6-22 31552 大鹏 2020-6-23 16:59
预览 Verilog中的信号 fpga_feixiang 2020-6-23 21262 zhangyukun 2020-6-23 15:55
预览 DDS系统参数选择 fpga_feixiang 2020-6-22 11264 fpga_feixiang 2020-6-22 21:51
预览 DDS基本原理 fpga_feixiang 2020-6-22 11191 fpga_feixiang 2020-6-22 21:50
预览 认识DDS fpga_feixiang 2020-6-22 21450 大鹏 2020-6-22 17:40
预览 有没有人用过arria 10的片子 ccs 2020-6-22 21189 大鹏 2020-6-22 17:40
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 我要注册

本版积分规则

关闭

站长推荐上一条 /1 下一条

QQ|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛 ( 京ICP备20003123号-1 )

GMT+8, 2025-12-14 08:01 , Processed in 0.088429 second(s), 17 queries .

Powered by Discuz! X3.4

Copyright © 2001-2023, Tencent Cloud.

返回顶部 返回版块