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预览 USB硬件接口	fpga_feixiang 2020-6-11	21744	大鹏 2020-6-16 17:29
预览 USB总线信号	fpga_feixiang 2020-6-11	21283	zxopenhl 2020-6-16 17:27
预览 USB2.0速度	fpga_feixiang 2020-6-11	21558	大鹏 2020-6-15 17:04
预览 USB数据编解码和位填充	fpga_feixiang 2020-6-11	21249	大鹏 2020-6-15 17:04
预览 USB的重要关键概念	fpga_feixiang 2020-6-12	21175	zxopenhl 2020-6-15 17:03
预览 VHDL和Verilog共同点	fpga_feixiang 2020-6-8	21303	大鹏 2020-6-11 11:29
预览均值滤波	fpga_feixiang 2020-5-27	21379	大鹏 2020-6-11 11:29
预览 DLL	fpga_feixiang 2020-6-5	31432	zxopenhl 2020-6-11 11:27
预览 pn码，m序列产生原理	fpga_feixiang 2020-5-24	41630	大鹏 2020-6-10 14:57
预览 fpga+dsp采集板的接口问题	小泡泡 2010-4-20	22975	大鹏 2020-6-10 14:56
预览 modelsim仿真	残酷月光 2020-6-9	21195	大鹏 2020-6-10 14:56
预览用verilog状态机做一个电梯控制器的课程设计	AAT 2010-6-26	23794	zxopenhl 2020-6-10 14:54
预览 VHDL和Verilog特点	fpga_feixiang 2020-6-8	21338	大鹏 2020-6-9 15:47
预览 verilog模块特点	fpga_feixiang 2020-6-8	21210	大鹏 2020-6-9 15:46
预览 verilog模块的结构	fpga_feixiang 2020-6-8	21251	zxopenhl 2020-6-9 15:43
预览什么是DDR SDRAM及它的特性	fpga_feixiang 2020-6-5	21249	大鹏 2020-6-6 15:19
预览深度解析DDR3内存新特性	fpga_feixiang 2020-6-5	31405	大鹏 2020-6-6 15:19
预览 sdram存储原理	fpga_feixiang 2020-6-5	31378	zxopenhl 2020-6-6 15:17
预览 SDRAM与DDR的不同	fpga_feixiang 2020-6-3	21293	大鹏 2020-6-4 14:29
预览 DDR和SDRAM有什么区别	fpga_feixiang 2020-6-3	21441	大鹏 2020-6-4 14:28
预览什么是DDR2 SDRAM	fpga_feixiang 2020-6-3	31476	zxopenhl 2020-6-4 14:27
预览 m序列verilog	fpga_feixiang 2020-5-24	31504	大鹏 2020-6-3 14:24
预览常用本原多项式	fpga_feixiang 2020-5-24	21196	大鹏 2020-6-3 14:23
预览哪位大神有AXI的中文协议求发一下	arteart 2020-6-1	21288	zxopenhl 2020-6-3 14:22
预览中值滤波	fpga_feixiang 2020-5-27	32134	大鹏 2020-6-2 16:20
预览通讯校检	fpga_feixiang 2020-5-30	31393	月影星痕 2020-5-31 17:36
预览常见CRC参数模型	fpga_feixiang 2020-5-30	51569	月影星痕 2020-5-31 17:35
预览硬件加速	fpga_feixiang 2020-5-30	32843	月影星痕 2020-5-31 17:35
预览中值滤波C代码	fpga_feixiang 2020-5-27	21431	大鹏 2020-5-28 16:39
预览 FPGA仿真，无波形，求助！！	lihuailiang 2020-5-23	41458	lihuailiang 2020-5-27 19:12
预览 matlab就提供了产生M序列的专门函数	fpga_feixiang 2020-5-24	41704	大鹏 2020-5-27 15:50
预览汉明码校验错误实例	fpga_feixiang 2020-5-21	31452	zxopenhl 2020-5-27 15:47
预览 Xilinx Kintex-7 FPGA开发板支持接口32位 DDR4 SDRAM	英尚微电子 2020-5-19	31483	英尚微电子 2020-5-27 14:58
预览英特尔Arria 10 SOC FPGA开发板硬件支持32位 DDR4 SDRAM	英尚微电子 2020-5-20	31424	英尚微电子 2020-5-27 14:57
预览 modelsim仿真时，提示module 'altsyncram' is not defined	ccs 2020-5-26	11211	ccs 2020-5-26 16:35
预览请问一下，用chipscope下载程序时出现的问题是怎么回事啊	ccs 2020-5-26	11138	ccs 2020-5-26 16:34
预览 Xilinx FPGA提供DDR4内存接口解决方案	英尚微电子 2020-5-22	31466	大鹏 2020-5-25 18:09
预览自己做了个计时器，但是modelsim仿真没有输出	残酷月光 2020-5-25	11300	残酷月光 2020-5-25 17:11
预览 m序列的简介m序列的简介	fpga_feixiang 2020-5-19	41483	大鹏 2020-5-22 16:43
预览汉明码编码实例	fpga_feixiang 2020-5-21	21208	zxopenhl 2020-5-22 16:41