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预览 异步串行数字收发通信端口(UART)的Modelsim仿真 attach_img lcytms 2018-4-9 42401 zhangyukun 2018-4-10 09:21
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预览 基于Verilog—AMS的DC—DC变换器行为级稳定性设计 attach_img lcytms 2018-4-6 53214 zhangyukun 2018-4-7 09:11
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预览 基于FPGA的LCD控制器设计 attach_img lcytms 2018-4-2 52962 晓灰灰 2018-4-3 11:07
预览 用Verilog语言设计任意次ASIC分频器 attach_img lcytms 2018-3-30 73056 晓灰灰 2018-3-30 11:52
预览 16*16位Wallace乘法器测试激励文件设计 attach_img lcytms 2018-3-29 42212 zhangyukun 2018-3-29 09:07
预览 基于FPGA的图像发生器的设计 attach_img lcytms 2018-3-25 94159 Adamancy 2018-3-27 18:41
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预览 基于QUARTUSⅡ的QPSK调制解调系统设计 attach_img lcytms 2018-3-24 32272 zhangyukun 2018-3-27 09:03
预览 将C算法转换为Verilog HDL实现的一种改进方法 attach_img lcytms 2018-3-26 62745 zhangyukun 2018-3-27 09:02
预览 亚稳态中，输出跳转到旧值这样在同步时钟链中会采集到一个旧值，旧值如何处理？ 晓灰灰 2018-3-26 22212 晓灰灰 2018-3-26 14:56
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