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预览 异步串行数字收发通信端口(UART)的Modelsim仿真 attach_img lcytms 2018-4-9 42246 zhangyukun 2018-4-10 09:21
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预览 用Verilog语言设计任意次ASIC分频器 attach_img lcytms 2018-3-30 72864 晓灰灰 2018-3-30 11:52
预览 16*16位Wallace乘法器测试激励文件设计 attach_img lcytms 2018-3-29 42067 zhangyukun 2018-3-29 09:07
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预览 基于QUARTUSⅡ的QPSK调制解调系统设计 attach_img lcytms 2018-3-24 32153 zhangyukun 2018-3-27 09:03
预览 将C算法转换为Verilog HDL实现的一种改进方法 attach_img lcytms 2018-3-26 62602 zhangyukun 2018-3-27 09:02
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