FPGA快速入门-RAM配置

FPGA快速入门-RAM配置
在RAM的第一个配置页面中（即“Parameter Settings à Widths/Blk Type/Clks”页面），如图所示进行配置，这里设置RAM的位宽为8bits，深度为32个words。其他设置如图1使用默认设置。

图1 RAM Widths/Blk Type/Clks配置页面
如图2所示，第二个配置页面（即“Parameter Settings à Regs/Clken/Byte Enable/Aclrs”页面）勾选“’q’ output port”

图2 RAM Regs/Clken/Byt Enable/Aclrs配置页面
         其他几个页面使用默认设置，最后我们在Summary页面中，如图3所示，确保勾选上ram_controller_inst.v文件的选项，该文件是这个IP核的例化模板。

图3 RAM Summary配置页面
点击“Finish”完成IP核的配置。
如图4所示，我们可以在文件夹“…/ip_core/ram”下查看生产的IP核相关源文件。

图4 RAM IP源文件所在文件夹
例化模板ram_controller_inst.v打开如图5所示，复制到工程源码中，对“(  )”内的“*_sig”信号接口更改并做好映射，就可以将其集成到我们的设计中。

图5 RAM IP核例化模板
如图6代码所示，在我们的设计中，我们将RAM的时钟（clock）、地址（address）、写入数据（data）、写数据使能信号（wren）和读出数据（q）分别映射连接。

图 6 RAM IP核在实际代码中的例化

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