同步复位在VHDL中的两种表达方式

同步复位在VHDL中的两种表达方式
1. PROCESS(Clk)
    BEGIN
    IF (RST='1') THEN
        NULL;
   ELSIF CLK'EVENT AND CLK='1' THEN
       NULL;
   END IF;
  END PROCESS;
2. PROCESS(Clk,Rst)
    BEGIN
    IF (RST='1') THEN
        NULL;
   ELSIF CLK'EVENT AND CLK='1' THEN
       NULL;
   END IF;
  END PROCESS;

同步复位在VHDL中的两种表达方式

同步复位在VHDL中的两种表达方式

同步复位在VHDL中的两种表达方式

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http://www.fpgaw.com/forum.php?m ... 6&fromuid=59831
(出处: 集成电路技术分享)