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fpga_feixiang 发表于 2021-4-7 13:59:54 | 显示全部楼层 |阅读模式
module gry2bin(Gry,Bin);
parameter length = 8;
input [length-1:0] Gry;
output [length-1:0] Bin;
reg [length-1:0] Bin;
integer i;
always @ (Gry)begin      
Bin[length-1]=Gry[length-1];      
for(i=length-2;i>=0;i=i-1)               
Bin[i]=Bin[i+1]^Gry[i];
end
endmodule
zhangyukun 发表于 2021-4-8 09:49:24 | 显示全部楼层
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zxopenhl 发表于 2021-4-9 16:37:30 | 显示全部楼层
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zxopenchenxi 发表于 2021-4-10 19:51:44 | 显示全部楼层

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zxopenluyutong 发表于 2021-4-11 09:17:47 | 显示全部楼层
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