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集成电路技术分享»论坛 › › FPGA技术交流 › Verilog经验谈
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楼主: TCL

Verilog经验谈

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fullattack 发表于 2010-10-29 19:23:07 | 显示全部楼层
果然够经验，受益匪浅
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wolinfeng 发表于 2010-11-6 19:27:50 | 显示全部楼层
说的真好，好想快点如此体会
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cappuccino137 发表于 2010-11-8 10:54:25 | 显示全部楼层
厉害！厉害！
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littlepen 发表于 2010-11-13 09:31:14 | 显示全部楼层
谢谢分享拉了拉
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weibode01 发表于 2010-11-13 19:03:38 | 显示全部楼层
好的，看了一遍，觉得挺实在的
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xiangzhiwu 发表于 2010-11-16 09:10:09 | 显示全部楼层
收藏了，不知VHDL是否也是一样有这样的规范
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weibode01 发表于 2010-11-16 12:28:17 | 显示全部楼层
所有语言编程都很注意语法规则的
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hunao2000 发表于 2010-12-9 16:53:42 | 显示全部楼层
好经验，值得
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baihan1987 发表于 2010-12-12 21:46:36 | 显示全部楼层
讲的很好呀，谢谢楼主呀
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yuchunna2006 发表于 2010-12-15 14:18:30 | 显示全部楼层
谢谢O(∩_∩)O~
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