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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › USB2.0电平表示
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USB2.0电平表示

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zxopenfq 发表于 2021-4-15 14:40:23 | 显示全部楼层 |阅读模式
电平表示
J状态+高，D-低，在传输数据的时候表示数据1
K状态+低，D-高，在传输数据的时候表示数据0
SEO状态：+低，D-低，数据包传输结束
RESET状态：+<=VOL，D-低<=VOL，表示HOST复位FUCTION
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FPGA就业培训班招聘学员（保就业）
大鹏 发表于 2021-4-18 14:35:06 | 显示全部楼层
USB2.0电平表示
FPGA工程师就业培训班（保就业）
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zxopenhl 发表于 2022-1-21 17:54:25 | 显示全部楼层
USB2.0电平表示
至芯科技ZX系列开发板正在火爆发售！
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