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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › VHDL还是Verilog好？
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VHDL还是Verilog好？

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xiaoxiaocao 发表于 2012-9-10 15:02:54 | 显示全部楼层 |阅读模式
用VHDL有两年了，也还算熟练，但现在看好多同志都开始用Verilog了，也有点蠢蠢欲动了
到底用什么好呢？有没有大师多方位的分析一下
Verilog, VHDL

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