|
1395| 0
|
有谁知道在软核硬件部分设计中,最后引脚配置时 方向不显示 input 或者 output |
/1
|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛
( 京ICP备20003123号-1 )
GMT+8, 2026-2-8 05:37 , Processed in 0.078639 second(s), 20 queries .
Powered by Discuz! X3.4
Copyright © 2001-2023, Tencent Cloud.