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fpga论坛|fpga设计论坛»论坛 › › FPGA学习步骤 › 时钟与触发器的关系
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楼主: zhiweiqiang33

时钟与触发器的关系

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星宇 发表于 2017-2-16 20:13:20 | 显示全部楼层
很好地知识，谢谢楼主
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 楼主| zhiweiqiang33 发表于 2017-2-17 16:28:04 | 显示全部楼层
时钟的特性以及设计原则
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4798345 发表于 2017-3-13 15:43:04 | 显示全部楼层
感谢分享         
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 楼主| zhiweiqiang33 发表于 2017-3-14 09:55:52 | 显示全部楼层
不客气的 相互学习
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4798345 发表于 2017-3-27 16:06:10 | 显示全部楼层
     理解到位后才能更好的学习
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 楼主| zhiweiqiang33 发表于 2017-3-27 16:47:41 | 显示全部楼层
是的 理解到位 才能下手写Verilog
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wuli韬韬 发表于 2017-3-28 13:44:30 | 显示全部楼层

有些概念性的东西必须理解到位
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 楼主| zhiweiqiang33 发表于 2017-3-28 14:31:26 | 显示全部楼层
嗯恩 是的 概念性的问题石重点
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fpga_feixiang 发表于 2023-11-28 14:49:33 | 显示全部楼层
6                     
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