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楼主: lcytms

跟李凡老师学FPGA扩频通信D01:串行通信基础(20170418课堂笔记)

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 楼主| lcytms 发表于 2017-8-3 09:29:54 | 显示全部楼层
1004
        有静音的情况之下,CDR就无能为力了。
        CDR一定要通过signal的信号翻转点,恢复出时钟。
        没有翻转点,它就没有时钟。
        如果有很长一段的0,很长一段的1,将会产生静音,将会导致CDR失效。
        于是CDR上绝对不允许有静音。
        怎么办呢?
        这就要求在发送器这一端,对这个signal信号先做加工。
        我们马上就会说到,在频率均衡的地方,现代方法就是,对这个信号本身做编码。

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 楼主| lcytms 发表于 2017-8-4 09:09:58 | 显示全部楼层
1005
        对并行的DATA进行编码,不允许它全零。
        如果它是全零,输出的串行也不能是全零。
        这是第一点。
 楼主| lcytms 发表于 2017-8-4 09:10:36 | 显示全部楼层
1006
        第二点,第一个data和第二个data不能一样,长成一样可能会导致信道的静音。
        信道它之间的间隔太少。
        CDR要满足翻转率。
        必须要有指定的翻转点。
        如何做到这一点呢?
        B8/B10,B64/B65。
 楼主| lcytms 发表于 2017-8-4 09:11:54 | 显示全部楼层
1007
        现在IP核里面就有这个。
        谁发明的呢?
        IBM。
        把DATA转换为串行数据的时候,这个时候就采用特定的编码方式。
        就用B8/B10,B64/B65。
        我们现在看到做的比较多的是B8/B10。

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 楼主| lcytms 发表于 2017-8-13 23:47:49 | 显示全部楼层
1008
        CDR无随路时钟,它才能做到极致。
        现在高于1个G的通信,全部都是CDR。
        先休息十分钟。
(休息)
 楼主| lcytms 发表于 2017-8-13 23:48:50 | 显示全部楼层
1018
        我们把所有的对齐问题讨论清楚之后,接下来我们来看一下Altera它的架构怎么支持。

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 楼主| lcytms 发表于 2017-8-13 23:49:14 | 显示全部楼层
1019
        第一种是约定时钟,第二种是时钟同步,第三种是随路时钟同步,第四种就是DPA,最高的一种,也是最后的一种,无随路时钟。
        现代通信系统里面基本就是这样。
 楼主| lcytms 发表于 2017-8-13 23:49:41 | 显示全部楼层
1020
        PCI技术。
        在667M甚至更高的速度,它就会带来一些问题。
        现代的PCIE把并行去掉了,改串行了。
        串行比并行快。
 楼主| lcytms 发表于 2017-8-13 23:50:30 | 显示全部楼层
1021
        串行可以到1个G以上,并行还有那么多的信号要对齐,那是不可能的。
        这样的话,我们就解决了比特边界的问题。
        当比特边界对齐了以后,剩下的就是我们来解决并化和串化的问题。
        这是数的边界,帧的边界,字节的边界。

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 楼主| lcytms 发表于 2017-8-16 09:45:32 | 显示全部楼层
1022
        比特边界,刚才我们说了五种方案。
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