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楼主: lcytms

跟李凡老师学FPGA扩频通信D04:串行通信扩频发送器(20170422课堂笔记)

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 楼主| lcytms 发表于 2018-6-13 09:25:52 | 显示全部楼层
0951
        扩频前的。
        扩频后的。
        刚才说了,扩频前,基带上面,0就是0,1就是1。
        内核运算数据是什么,就是什么。

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 楼主| lcytms 发表于 2018-6-13 09:26:59 | 显示全部楼层
0952
        然后呢,我们要通过直接序列扩频,将它原来的一个比特,原来的0,变成直接序列。
        我们加上一个特定的序列,DS。
        这个直接数,怎么做呢?
        刚才我们说了,如果是1,我们要用10100101来替代。
        那么这个DS就会产生对应的8个比特。
        就是A5H。

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 楼主| lcytms 发表于 2018-6-14 09:34:57 | 显示全部楼层
0953
        马上我们就来讨论,什么样的数学模型做出这个DS?
        DS产生的这个时钟,会产生8个1010。
        我们画出它的时序图。
        我画时序图,简单一点。
        1用1010,0用0101,来做它的扩频。
  

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 楼主| lcytms 发表于 2018-6-14 09:36:53 | 显示全部楼层
0954
        这样的话,我们会产生DS的一个数。
        使能信号启动了以后,在DS上始终是出现一个特定的序列。
        在DSSS这个模块的部分,我们加上异或门。
        那么这个DS的KEY,0101,就应该是做DS序列的秘钥。
        它有一定的加密的特性。
        0跟任何书相异或,都等于它。
        1跟任何数异或,都是它的反码。

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 楼主| lcytms 发表于 2018-6-14 09:37:52 | 显示全部楼层
0955
        这个时钟呢,我们是基于扩频后的时钟。
        就是4倍的时钟。
        这个时钟是扩频的时钟。
        这个pds,它的驱动,是clk0。

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 楼主| lcytms 发表于 2018-6-15 09:41:40 | 显示全部楼层
0956
        然后呢,我们来看看这个信号。
        clk0是驱动pds这个信号,扩频前的。
        pds信号,1010。
        扩频后,ads,单拍潜伏期响应。
        1,用1010来替代。

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 楼主| lcytms 发表于 2018-6-15 09:43:28 | 显示全部楼层
0957
        画ads,扩频后的。

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 楼主| lcytms 发表于 2018-6-15 09:45:00 | 显示全部楼层
0958
        用这个1010来替代这个1。
        然后是0。
        0是0101。
        这是扩频前的,pds。
        这是扩频后的,ads。
        然后扩频后,也通过后面的调制器调制出去,在频带上单位时间是扩频了四倍。

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 楼主| lcytms 发表于 2018-6-18 23:52:53 | 显示全部楼层
0959
        在高斯分布的情况之下,有效的噪声干扰,它可能对其中的一个比特,造成干扰的可能性大得多。
        统计判决了以后呢,用统计判决的恢复的方式。
        用这个模型的话,我们就可以用一个异或门,就是直接序列这个秘钥,就能满足刚才我们所叙述的,它要有一定的加密特性,0和1要均布,统计上符合高斯分布的规律,不是想当然的一个数都可以做直接序列的。
        什么样的数可以做直接序列呢?
        不是任何数都可以做。
        这个数呢,我们称之为,一定要是一个随机数。或者说是一个伪随机数。
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