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跟李凡老师学FPGA控制SDRAM之D05:SDR的后仿(20170509课堂笔记)

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lcytms 发表于 2017-5-9 20:49:35 | 显示全部楼层 |阅读模式
李凡老师学FPGA控制SDRAM之D05:SDR的后仿(20170509课堂笔记)

用笨笔头整理课堂笔记,用以备忘,温故而知新。
整理文稿的细节处未能一一体现李凡老师讲课精髓和独特风采,有待下一步补充完善。
感谢李凡老师博大精深的学识、孜孜不倦的教诲,并敬请李凡老师原谅本人拙劣的课堂笔记。

近期精彩课程安排如下图。
实际执行可能会有所调整,谨供参考。

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 楼主| lcytms 发表于 2017-5-9 20:53:47 | 显示全部楼层
0905
        关键是能够写出来。
        所以说呢,我们进DDR2的课程之前,我们肯定要将我们已经写完的有读写的后仿的过程完成。
        顺序我想这样,上一节课V17的基础上,第二组做的验证好像有点问题。

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fpga_feixiang 发表于 2024-8-27 14:17:44 | 显示全部楼层
6               
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