跟李凡老师学FPGA控制SDRAM之D07：DDR3的IP核，数据搬运模块（20170511课堂笔记）

lcytms · 发表于 2017-5-11 22:20:21

跟李凡老师学FPGA控制SDRAM之D07：DDR3的IP核，数据搬运模块（20170511课堂笔记）

用笨笔头整理课堂笔记，用以备忘，温故而知新。
整理文稿的细节处未能一一体现李凡老师讲课精髓和独特风采，有待下一步补充完善。
感谢李凡老师博大精深的学识、孜孜不倦的教诲，并敬请李凡老师原谅本人拙劣的课堂笔记。

近期精彩课程安排如下图。
实际执行可能会有所调整，谨供参考。

lcytms · 发表于 2017-5-11 22:25:12

0902
这是我们准备做上电刷新的那个框架。
这是昨天那个同学写的。

lcytms · 发表于 2017-5-11 22:28:02

0903
指导设计。
你说一下，你修改在哪？
从s12跳到了idle，跳回去了。
分析综合。
运行仿真。

saddyxia · 发表于 2017-8-21 11:07:02

感谢楼主分享

小舍YZ · 发表于 2017-8-29 17:56:15

谢谢分享，很好，赞。。。。。。。。。。。。。

fpga_feixiang · 发表于 2017-8-30 15:24:42

李老师很厉害，资料也很好啊

fpga_feixiang · 发表于 2017-9-1 16:47:54

跟李凡老师学FPGA控制SDRAM之D07：DDR3的IP核，数据搬运模块（20170511课堂笔记）

小舍YZ · 发表于 2017-10-11 10:18:29

分析综合
运行仿真

aiblue · 发表于 2017-10-11 16:56:47

感谢楼主分享。

fpga_feixiang · 发表于 2017-10-13 13:57:45

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