IPO 发表于 2010-8-5 09:29:16

用Verilog写了一个串口的程序，只能收发单个字节，即收发8个数据位

用Verilog写了一个串口的程序，只能收发单个字节，即收发8个数据位。现要能够收发一串字符串，你知道应该怎样改吗？

IPO 发表于 2010-8-5 09:29:32

你要收一个字符串，那你先用个FIFO把多个字节缓存起来，当达到你要发送的长度要求的时候，一次性全部读出发送出去，接收也这么弄，你看怎么样

IPO 发表于 2010-8-5 09:29:57

要收的字符串是串口RXD上的一固定长度的一串
假如是ABCDEFG
我现在写的是接收到AB AB AB AB AB 其它的没有收到

期望的结果是收到ABCDEFG ABCDEFG ABCDEFG这样的

串口TXD上

IPO 发表于 2010-8-5 09:30:14

要收的字符串是串口RXD上的一固定长度的一串
假如是ABCDEFG
我现在写的是接收到AB AB AB AB AB 其它的没有 ...
IPO 发表于 2010-8-5 09:29 http://www.fpgaw.com/images/common/back.gif


    你发送一次ABCDEFG，竟然收到多个AB？

IPO 发表于 2010-8-5 09:30:29

时钟在走撒
然后就是发送端也是按周期发送
发送端1S钟发一次
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